mirror of https://github.com/zachjs/sv2v.git
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442 B
Verilog
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442 B
Verilog
module top;
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initial begin
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$display("intf.P.x %0d", 1);
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$display("intf.P.y %0d", 2);
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$display("intf.P.x %0d", 4);
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$display("intf.P.y %0d", 6);
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$display("intf.P.x %0d", 4);
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$display("intf.P.y %0d", 6);
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$display("mod.f.x %b", {8'd1, 16'd2});
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$display("mod.f.y %b", 32'h1);
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$display("mod.f.x %b", {8'd4, 16'd6});
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$display("mod.f.y %b", 32'hF);
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end
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endmodule
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