mirror of https://github.com/zachjs/sv2v.git
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4.1 KiB
Verilog
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Verilog
module top;
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reg inp;
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initial begin
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$display("Hello I'm Interface!");
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$display("Hello I'm Interface!");
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$display("Hello I'm Interface!");
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$display("Hello I'm ModuleA 0!");
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$display("Hello I'm ModuleA 1!");
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$display("Hello I'm ModuleA 1!");
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$display("Hello I'm ModuleB 3!");
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$display("Hello I'm ModuleB 2!");
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$display("Hello I'm ModuleB 1!");
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$display("Hello I'm ModuleB 1!");
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$display("Hello I'm ModuleB 1!");
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$display("Hello I'm ModuleB 3!");
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$display("Hello I'm ModuleASet 1 1 0!");
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$display("Hello I'm Interface!");
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$display("Hello I'm Interface!");
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$display("Hello I'm Interface!");
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$display("Hello I'm ModuleA 0!");
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$display("Hello I'm ModuleA 1!");
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$display("Hello I'm ModuleA 1!");
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$display("Hello I'm ModuleB 3!");
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$display("Hello I'm ModuleB 2!");
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$display("Hello I'm ModuleB 1!");
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$display("Hello I'm ModuleB 1!");
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$display("Hello I'm ModuleB 1!");
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$display("Hello I'm ModuleB 3!");
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$display("Hello I'm ModuleCSet 0 0 1!");
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inp = 0; tick;
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inp = 1; tick;
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inp = 0; tick;
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inp = 1; tick;
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end
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task tick; begin
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#1;
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$display("I i = %b, v = %b, o = %b", inp, inp, inp ^ 1'b1);
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$display("I i = %b, v = %b, o = %b", inp, inp ^ 1'b1, inp ^ 1'b1);
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$display("I i = %b, v = %b, o = %b", inp, inp ^ 1'b1, inp);
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$display("A i.v = %b", inp);
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$display("A i.v = %b", inp ^ 1'b1);
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$display("A i.v = %b", inp ^ 1'b1);
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$display("B i_concat = %b, v_concat = %b", {3 {inp}}, {inp, inp ^ 1'b1, inp ^ 1'b1});
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$display("BN i_concat = %b, v_concat = %b", {3 {inp}}, {inp, inp ^ 1'b1, inp ^ 1'b1});
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$display("B i_concat = %b, v_concat = %b", {2 {inp}}, {inp, inp ^ 1'b1});
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$display("BN i_concat = %b, v_concat = %b", {2 {inp}}, {inp, inp ^ 1'b1});
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$display("B i_concat = %b, v_concat = %b", {1 {inp}}, inp);
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$display("BN i_concat = %b, v_concat = %b", {1 {inp}}, inp);
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$display("B i_concat = %b, v_concat = %b", {1 {inp}}, inp ^ 1'b1);
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$display("BN i_concat = %b, v_concat = %b", {1 {inp}}, inp ^ 1'b1);
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$display("B i_concat = %b, v_concat = %b", {1 {inp}}, inp ^ 1'b1);
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$display("BN i_concat = %b, v_concat = %b", {1 {inp}}, inp ^ 1'b1);
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$display("B i_concat = %b, v_concat = %b", {3 {inp}}, {inp, inp ^ 1'b1, inp ^ 1'b1});
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$display("BN i_concat = %b, v_concat = %b", {3 {inp}}, {inp, inp ^ 1'b1, inp ^ 1'b1});
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$display("AS i.v = %b", inp ^ 1'b1);
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$display("AS i.v = %b", inp ^ 1'b1);
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$display("AS i.v = %b", inp);
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$display("I i = %b, v = %b, o = %b", inp, inp ^ 1'b1, inp);
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$display("I i = %b, v = %b, o = %b", inp, inp, inp);
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$display("I i = %b, v = %b, o = %b", inp, inp, inp ^ 1'b1);
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$display("A i.v = %b", inp ^ 1'b1);
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$display("A i.v = %b", inp);
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$display("A i.v = %b", inp);
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$display("B i_concat = %b, v_concat = %b", {3 {~inp}}, {inp ^ 1'b1, inp, inp});
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$display("BN i_concat = %b, v_concat = %b", {3 {~inp}}, {inp ^ 1'b1, inp, inp});
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$display("B i_concat = %b, v_concat = %b", {2 {~inp}}, {inp ^ 1'b1, inp});
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$display("BN i_concat = %b, v_concat = %b", {2 {~inp}}, {inp ^ 1'b1, inp});
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$display("B i_concat = %b, v_concat = %b", {1 {~inp}}, inp ^ 1'b1);
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$display("BN i_concat = %b, v_concat = %b", {1 {~inp}}, inp ^ 1'b1);
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$display("B i_concat = %b, v_concat = %b", {1 {~inp}}, inp);
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$display("BN i_concat = %b, v_concat = %b", {1 {~inp}}, inp);
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$display("B i_concat = %b, v_concat = %b", {1 {~inp}}, inp);
|
|
$display("BN i_concat = %b, v_concat = %b", {1 {~inp}}, inp);
|
|
$display("B i_concat = %b, v_concat = %b", {3 {~inp}}, {inp ^ 1'b1, inp, inp});
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$display("BN i_concat = %b, v_concat = %b", {3 {~inp}}, {inp ^ 1'b1, inp, inp});
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$display("CS i.v = %b", inp);
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$display("CS i.v = %b", inp);
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$display("CS i.v = %b", inp ^ 1'b1);
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end
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endtask
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endmodule
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