mirror of https://github.com/YosysHQ/yosys.git
gowin: wire output clock enable ports to enable inputs, not constants
This commit is contained in:
parent
4716f4410f
commit
5f4be8c0a8
|
|
@ -239,7 +239,7 @@ if (PORT_A_WIDTH < 9 || PORT_B_WIDTH < 9) begin
|
||||||
.CEA(PORT_A_CLK_EN),
|
.CEA(PORT_A_CLK_EN),
|
||||||
.WREA(PORT_A_WR_EN),
|
.WREA(PORT_A_WR_EN),
|
||||||
.RESETA(RSTA),
|
.RESETA(RSTA),
|
||||||
.OCEA(1'b1),
|
.OCEA(PORT_A_CLK_EN),
|
||||||
.ADA(ADA),
|
.ADA(ADA),
|
||||||
.DIA(DIA),
|
.DIA(DIA),
|
||||||
.DOA(DOA),
|
.DOA(DOA),
|
||||||
|
|
@ -248,7 +248,7 @@ if (PORT_A_WIDTH < 9 || PORT_B_WIDTH < 9) begin
|
||||||
.CEB(PORT_B_CLK_EN),
|
.CEB(PORT_B_CLK_EN),
|
||||||
.WREB(PORT_B_WR_EN),
|
.WREB(PORT_B_WR_EN),
|
||||||
.RESETB(RSTB),
|
.RESETB(RSTB),
|
||||||
.OCEB(1'b1),
|
.OCEB(PORT_B_CLK_EN),
|
||||||
.ADB(ADB),
|
.ADB(ADB),
|
||||||
.DIB(DIB),
|
.DIB(DIB),
|
||||||
.DOB(DOB),
|
.DOB(DOB),
|
||||||
|
|
@ -283,7 +283,7 @@ end else begin
|
||||||
.CEA(PORT_A_CLK_EN),
|
.CEA(PORT_A_CLK_EN),
|
||||||
.WREA(PORT_A_WR_EN),
|
.WREA(PORT_A_WR_EN),
|
||||||
.RESETA(RSTA),
|
.RESETA(RSTA),
|
||||||
.OCEA(1'b1),
|
.OCEA(PORT_A_CLK_EN),
|
||||||
.ADA(ADA),
|
.ADA(ADA),
|
||||||
.DIA(DIA),
|
.DIA(DIA),
|
||||||
.DOA(DOA),
|
.DOA(DOA),
|
||||||
|
|
@ -292,7 +292,7 @@ end else begin
|
||||||
.CEB(PORT_B_CLK_EN),
|
.CEB(PORT_B_CLK_EN),
|
||||||
.WREB(PORT_B_WR_EN),
|
.WREB(PORT_B_WR_EN),
|
||||||
.RESETB(RSTB),
|
.RESETB(RSTB),
|
||||||
.OCEB(1'b1),
|
.OCEB(PORT_B_CLK_EN),
|
||||||
.ADB(ADB),
|
.ADB(ADB),
|
||||||
.DIB(DIB),
|
.DIB(DIB),
|
||||||
.DOB(DOB),
|
.DOB(DOB),
|
||||||
|
|
|
||||||
Loading…
Reference in New Issue