Fix opening a VerilatedVcdC file multiple times, msg1021.
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Wilson Snyder
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1fb2762725
commit
e6808a787c
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@ -21,6 +21,8 @@ indicates the contributor was also the author of the fix; Thanks!
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**** Fix 32-bit OS VPI scan issue, bug615. [Jeremy Bennett, Rich Porter]
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**** Fix 32-bit OS VPI scan issue, bug615. [Jeremy Bennett, Rich Porter]
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**** Fix opening a VerilatedVcdC file multiple times, msg1021. [Frederic Requin]
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* Verilator 3.845 2013/02/04
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* Verilator 3.845 2013/02/04
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@ -157,6 +157,8 @@ void VerilatedVcd::openNext (bool incFilename) {
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void VerilatedVcd::makeNameMap() {
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void VerilatedVcd::makeNameMap() {
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// Take signal information from each module and build m_namemapp
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// Take signal information from each module and build m_namemapp
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deleteNameMap();
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m_nextCode = 1;
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m_namemapp = new NameMap;
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m_namemapp = new NameMap;
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for (vluint32_t ent = 0; ent< m_callbacks.size(); ent++) {
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for (vluint32_t ent = 0; ent< m_callbacks.size(); ent++) {
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VerilatedVcdCallInfo *cip = m_callbacks[ent];
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VerilatedVcdCallInfo *cip = m_callbacks[ent];
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@ -183,15 +185,20 @@ void VerilatedVcd::makeNameMap() {
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newname += hiername;
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newname += hiername;
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newmapp->insert(make_pair(newname,decl));
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newmapp->insert(make_pair(newname,decl));
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}
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}
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delete m_namemapp; m_namemapp=NULL;
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deleteNameMap();
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m_namemapp = newmapp;
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m_namemapp = newmapp;
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}
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}
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}
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}
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void VerilatedVcd::deleteNameMap() {
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if (m_namemapp) { delete m_namemapp; m_namemapp=NULL; }
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}
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VerilatedVcd::~VerilatedVcd() {
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VerilatedVcd::~VerilatedVcd() {
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close();
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close();
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if (m_wrBufp) { delete[] m_wrBufp; m_wrBufp=NULL; }
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if (m_wrBufp) { delete[] m_wrBufp; m_wrBufp=NULL; }
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if (m_sigs_oldvalp) { delete[] m_sigs_oldvalp; m_sigs_oldvalp=NULL; }
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if (m_sigs_oldvalp) { delete[] m_sigs_oldvalp; m_sigs_oldvalp=NULL; }
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deleteNameMap();
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// Remove from list of traces
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// Remove from list of traces
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vector<VerilatedVcd*>::iterator pos = find(s_vcdVecp.begin(), s_vcdVecp.end(), this);
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vector<VerilatedVcd*>::iterator pos = find(s_vcdVecp.begin(), s_vcdVecp.end(), this);
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if (pos != s_vcdVecp.end()) { s_vcdVecp.erase(pos); }
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if (pos != s_vcdVecp.end()) { s_vcdVecp.erase(pos); }
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@ -414,7 +421,7 @@ void VerilatedVcd::dumpHeader () {
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assert (m_modDepth==0);
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assert (m_modDepth==0);
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// Reclaim storage
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// Reclaim storage
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delete m_namemapp;
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deleteNameMap();
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}
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}
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void VerilatedVcd::module (string name) {
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void VerilatedVcd::module (string name) {
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@ -57,7 +57,8 @@ typedef void (*VerilatedVcdCallback_t)(VerilatedVcd* vcdp, void* userthis, vluin
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//=============================================================================
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//=============================================================================
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// VerilatedVcd
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// VerilatedVcd
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/// Create a SystemPerl VCD dump
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/// Base class to create a Verilator VCD dump
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/// This is an internally used class - see VerilatedVcdC for what to call from applications
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class VerilatedVcd {
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class VerilatedVcd {
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private:
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private:
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@ -100,6 +101,7 @@ private:
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void closeErr();
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void closeErr();
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void openNext();
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void openNext();
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void makeNameMap();
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void makeNameMap();
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void deleteNameMap();
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void printIndent (int levelchange);
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void printIndent (int levelchange);
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void printStr (const char* str);
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void printStr (const char* str);
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void printQuad (vluint64_t n);
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void printQuad (vluint64_t n);
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@ -400,8 +402,12 @@ public:
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bool isOpen() const { return m_sptrace.isOpen(); }
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bool isOpen() const { return m_sptrace.isOpen(); }
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// METHODS
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// METHODS
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/// Open a new VCD file
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/// Open a new VCD file
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/// This includes a complete header dump each time it is called,
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/// just as if this object was deleted and reconstructed.
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void open (const char* filename) { m_sptrace.open(filename); }
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void open (const char* filename) { m_sptrace.open(filename); }
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||||||
/// Continue a VCD dump by rotating to a new file name
|
/// Continue a VCD dump by rotating to a new file name
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/// The header is only in the first file created, this allows
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/// "cat" to be used to combine the header plus any number of data files.
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void openNext (bool incFilename=true) { m_sptrace.openNext(incFilename); }
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void openNext (bool incFilename=true) { m_sptrace.openNext(incFilename); }
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||||||
/// Set size in megabytes after which new file should be created
|
/// Set size in megabytes after which new file should be created
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void rolloverMB(size_t rolloverMB) { m_sptrace.rolloverMB(rolloverMB); };
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void rolloverMB(size_t rolloverMB) { m_sptrace.rolloverMB(rolloverMB); };
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@ -0,0 +1,80 @@
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// -*- mode: C++; c-file-style: "cc-mode" -*-
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//
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// DESCRIPTION: Verilator: Verilog Test module
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//
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// This file ONLY is placed into the Public Domain, for any use,
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// without warranty, 2008 by Wilson Snyder.
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#include <verilated.h>
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#include <verilated_vcd_c.h>
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#if defined(T_TRACE_CAT)
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# include "Vt_trace_cat.h"
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#elif defined(T_TRACE_CAT_REOPEN)
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# include "Vt_trace_cat_reopen.h"
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#elif defined(T_TRACE_CAT_RENEW)
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||||||
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# include "Vt_trace_cat_renew.h"
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#else
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# error "Unknown test"
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#endif
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unsigned long long main_time = 0;
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double sc_time_stamp() {
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return (double)main_time;
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}
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const char* trace_name() {
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static char name[1000];
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#if defined(T_TRACE_CAT)
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|
snprintf(name,1000,"obj_dir/t_trace_cat/simpart_%04d.vcd", (int)main_time);
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#elif defined(T_TRACE_CAT_REOPEN)
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||||||
|
snprintf(name,1000,"obj_dir/t_trace_cat_reopen/simpart_%04d.vcd", (int)main_time);
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||||||
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#elif defined(T_TRACE_CAT_RENEW)
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||||||
|
snprintf(name,1000,"obj_dir/t_trace_cat_renew/simpart_%04d.vcd", (int)main_time);
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#else
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|
# error "Unknown test"
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||||||
|
#endif
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return name;
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}
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int main(int argc, char **argv, char **env) {
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VM_PREFIX* top = new VM_PREFIX("top");
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Verilated::debug(0);
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Verilated::traceEverOn(true);
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VerilatedVcdC* tfp = new VerilatedVcdC;
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top->trace(tfp,99);
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tfp->open(trace_name());
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top->clk = 0;
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while (main_time < 190) { // Creates 2 files
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top->clk = ~top->clk;
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top->eval();
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if ((main_time % 100) == 0) {
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#if defined(T_TRACE_CAT)
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tfp->openNext(true);
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#elif defined(T_TRACE_CAT_REOPEN)
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tfp->close();
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tfp->open(trace_name());
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#elif defined(T_TRACE_CAT_RENEW)
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|
tfp->close();
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|
delete tfp;
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|
VerilatedVcdC* tfp = new VerilatedVcdC;
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|
top->trace(tfp,99);
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|
tfp->open(trace_name());
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#else
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# error "Unknown test"
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#endif
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|
}
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|
tfp->dump((unsigned int)(main_time));
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++main_time;
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}
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|
tfp->close();
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|
top->final();
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|
printf ("*-* All Finished *-*\n");
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return 0;
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}
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@ -0,0 +1,490 @@
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$version Generated by VerilatedVcd $end
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$date Sat Feb 23 20:39:34 2013
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$end
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$timescale 1ns $end
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$scope module top $end
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$var wire 1 $ clk $end
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$scope module v $end
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$var wire 1 $ clk $end
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$var wire 32 # cyc [31:0] $end
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$upscope $end
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$upscope $end
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$enddefinitions $end
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#0
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b00000000000000000000000000000001 #
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#1
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#2
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b00000000000000000000000000000010 #
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1$
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#3
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0$
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#4
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b00000000000000000000000000000011 #
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#5
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0$
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#6
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b00000000000000000000000000000100 #
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1$
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#7
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0$
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#8
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b00000000000000000000000000000101 #
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#9
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b00000000000000000000000000000110 #
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b00000000000000000000000000000111 #
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#13
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b00000000000000000000000000001000 #
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b00000000000000000000000000001001 #
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1$
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0$
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b00000000000000000000000000001010 #
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0$
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b00000000000000000000000000001011 #
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1$
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#21
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0$
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#22
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b00000000000000000000000000001100 #
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#23
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0$
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b00000000000000000000000000001101 #
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1$
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#25
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0$
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#26
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b00000000000000000000000000001110 #
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1$
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#27
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0$
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#28
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b00000000000000000000000000001111 #
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1$
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#29
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0$
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#30
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b00000000000000000000000000010000 #
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1$
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#31
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0$
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#32
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b00000000000000000000000000010001 #
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1$
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#33
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0$
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#34
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b00000000000000000000000000010010 #
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1$
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#35
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0$
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#36
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b00000000000000000000000000010011 #
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1$
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0$
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#38
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b00000000000000000000000000010100 #
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1$
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#39
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0$
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#40
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b00000000000000000000000000010101 #
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1$
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#41
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0$
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#42
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b00000000000000000000000000010110 #
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1$
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0$
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#44
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b00000000000000000000000000010111 #
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0$
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#46
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b00000000000000000000000000011000 #
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1$
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#47
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0$
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#48
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b00000000000000000000000000011001 #
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1$
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#49
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0$
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b00000000000000000000000000011010 #
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#51
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0$
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#52
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b00000000000000000000000000011011 #
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#53
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0$
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#54
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b00000000000000000000000000011100 #
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#55
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#56
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b00000000000000000000000000011101 #
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0$
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b00000000000000000000000000011110 #
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b00000000000000000000000000011111 #
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#61
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0$
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b00000000000000000000000000100000 #
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b00000000000000000000000000100001 #
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1$
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#65
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0$
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#66
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b00000000000000000000000000100010 #
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1$
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#67
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0$
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#68
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b00000000000000000000000000100011 #
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#69
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0$
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1$
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0$
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0$
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#103
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#105
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0$
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#106
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#107
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#108
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#109
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#110
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#112
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#116
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#117
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#118
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#119
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#120
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#121
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#122
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#123
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#124
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#126
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#128
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#129
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#131
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#132
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1$
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#133
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0$
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#134
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b00000000000000000000000001000100 #
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1$
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#135
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0$
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#136
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1$
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#137
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0$
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#138
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1$
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#139
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0$
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#140
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1$
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#141
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#142
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#143
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#144
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#149
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#158
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#159
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#161
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0$
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#162
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1$
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#163
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0$
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#164
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1$
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#165
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0$
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#166
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b00000000000000000000000001010100 #
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1$
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#167
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0$
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#168
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1$
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#169
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#170
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#171
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#172
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#174
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#181
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#182
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#183
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#184
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#185
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#186
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#187
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#188
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#189
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0$
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@ -0,0 +1,28 @@
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#!/usr/bin/perl
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if (!$::Driver) { use FindBin; exec("$FindBin::Bin/bootstrap.pl", @ARGV, $0); die; }
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# DESCRIPTION: Verilator: Verilog Test driver/expect definition
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#
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# Copyright 2003-2013 by Wilson Snyder. This program is free software; you can
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# redistribute it and/or modify it under the terms of either the GNU
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# Lesser General Public License Version 3 or the Perl Artistic License
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# Version 2.0.
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$Self->{vlt} or $Self->skip("Verilator only test");
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compile (
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make_top_shell => 0,
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make_main => 0,
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v_flags2 => ["--trace --exe $Self->{t_dir}/t_trace_cat.cpp"],
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);
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execute (
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check_finished=>1,
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);
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system("cat $Self->{obj_dir}/simpart*.vcd > $Self->{obj_dir}/simall.vcd");
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vcd_identical ("$Self->{obj_dir}/simall.vcd",
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"t/$Self->{name}.out");
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ok(1);
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1;
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@ -0,0 +1,16 @@
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// DESCRIPTION: Verilator: Verilog Test module
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//
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// This file ONLY is placed into the Public Domain, for any use,
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|
// without warranty, 2013 by Wilson Snyder.
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|
module t
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(
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input wire clk
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);
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integer cyc; initial cyc = 0;
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always @ (posedge clk) begin
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cyc <= cyc + 1;
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|
end
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|
endmodule
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|
|
@ -0,0 +1,765 @@
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$version Generated by VerilatedVcd $end
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$date Sat Feb 23 20:18:07 2013
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$end
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$timescale 1ns $end
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$scope module top $end
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$var wire 1 $ clk $end
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$scope module v $end
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$var wire 1 $ clk $end
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$var wire 32 # cyc [31:0] $end
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$upscope $end
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$upscope $end
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$enddefinitions $end
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#0
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1$
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#5
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0$
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0$
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#8
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#10
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# DESCRIPTION: Verilator: Verilog Test driver/expect definition
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# Copyright 2003-2013 by Wilson Snyder. This program is free software; you can
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# redistribute it and/or modify it under the terms of either the GNU
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# Lesser General Public License Version 3 or the Perl Artistic License
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# Version 2.0.
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$Self->{vlt} or $Self->skip("Verilator only test");
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b00000000000000000000000001110111 #
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#297
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#298
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#299
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@ -0,0 +1,30 @@
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#!/usr/bin/perl
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if (!$::Driver) { use FindBin; exec("$FindBin::Bin/bootstrap.pl", @ARGV, $0); die; }
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# DESCRIPTION: Verilator: Verilog Test driver/expect definition
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# Copyright 2003-2013 by Wilson Snyder. This program is free software; you can
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# redistribute it and/or modify it under the terms of either the GNU
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# Lesser General Public License Version 3 or the Perl Artistic License
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# Version 2.0.
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$Self->{vlt} or $Self->skip("Verilator only test");
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top_filename("t_trace_cat.v");
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"t/$Self->{name}_0100.out");
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ok(1);
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1;
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@ -0,0 +1,265 @@
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$version Generated by VerilatedVcd $end
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$date Sat Feb 23 20:40:11 2013
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$end
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$upscope $end
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$enddefinitions $end
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#27
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#49
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