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Stephen Williams
cea237b407
By adding ivtest to the iverilog source tree, it is easier to keep the regression test synchronized with the source that is being tested. This should be especially helpful for PRs that add a new feature, and have a matching ivtest PR with the regression test for that feature.
128 lines
2.9 KiB
Verilog
128 lines
2.9 KiB
Verilog
// Released under GPL2.0
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// (c) 2002 Tom Verbeure
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module main;
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integer myInt;
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reg [39:0] myReg40;
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reg [0:39] myReg40r;
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reg [0:38] myReg39r;
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reg [13:0] myReg14;
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reg [7:0] myReg8;
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reg [31:0] myReg32;
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initial begin
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$display("============================ myReg14 = -10");
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myReg14 = -10;
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$display(">|16374|");
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$display("*|%d|", myReg14);
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$display("*|%0d|", myReg14);
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$display("*|",myReg14,"|");
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$display("============================ myReg14 = 65");
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myReg14 = 65;
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$display(">| 65|");
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$display("*|%d|", myReg14);
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$display("*|",myReg14,"|");
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$display(">|65|");
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$display("*|%0d|", myReg14);
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$display(">|0041|");
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$display("*|%h|", myReg14);
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$display(">|41|");
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$display("*|%0h|", myReg14);
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$display(">|00101|");
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$display("*|%o|", myReg14);
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$display(">|101|");
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$display("*|%0o|", myReg14);
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$display(">|00000001000001|");
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$display("*|%b|", myReg14);
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$display(">|1000001|");
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$display("*|%0b|", myReg14);
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$display(">| A|");
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$display("*|%s|", myReg14);
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$display(">|A|");
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$display("*|%0s|", myReg14);
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$display("============================ myInt = -10");
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myInt = -10;
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$display(">| -10|");
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$display("*|%d|", myInt);
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$display("*|",myInt,"|");
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$display(">|-10|");
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$display("*|%0d|", myInt);
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$display(">|fffffff6|");
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$display("*|%h|", myInt);
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$display("*|%0h|", myInt);
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$display(">|37777777766|");
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$display("*|%o|", myInt);
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$display("*|%0o|", myInt);
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$display(">|11111111111111111111111111110110|");
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$display("*|%b|", myInt);
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$display("*|%0b|", myInt);
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$display("============================ myReg32 = -10");
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myReg32 = -10;
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$display(">|4294967286|");
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$display("*|%d|", myReg32);
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$display("*|%0d|", myReg32);
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$display("*|",myReg32,"|");
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$display(">|fffffff6|");
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$display("*|%h|", myReg32);
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$display("*|%0h|", myReg32);
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$display(">|37777777766|");
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$display("*|%o|", myReg32);
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$display("*|%0o|", myReg32);
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$display("============================ myInt = 65");
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myInt = 65;
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$display(">| 65|");
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$display("*|%d|", myInt);
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$display("*|",myInt,"|");
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$display(">|65|");
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$display("*|%0d|", myInt);
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$display(">|00000041|");
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$display("*|%h|", myInt);
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$display(">|41|");
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$display("*|%0h|", myInt);
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$display(">|00000000101|");
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$display("*|%o|", myInt);
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$display(">|101|");
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$display("*|%0o|", myInt);
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$display(">|00000000000000000000000001000001|");
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$display("*|%b|", myInt);
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$display(">|1000001|");
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$display("*|%0b|", myInt);
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$display("*| A|");
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$display(">|%s|", myInt);
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$display("*|A|");
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$display(">|%0s|", myInt);
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$display("============================ Print \" A\"");
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$display("*| A|");
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$display(">|%s|", " A");
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$display(">|%0s|", " A");
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$display("============================ Print $time");
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$display("*| 0|");
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$display(">|%t|", $time);
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$display("*|0|");
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$display(">|%0t|", $time);
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end
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endmodule
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